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# RUN: llc -mtriple=x86_64-- -run-pass x86-evex-to-vex-compress -verify-machineinstrs -mcpu=skx -o - %s | FileCheck %s
# This test verifies VEX encdoing for AVX-512 instructions that use registers of low inedexes and
# do not use zmm or mask registers and have a corresponding AVX/AVX2 opcode

--- |
   define void @evex_z256_to_vex_test() { ret void }
   define void @evex_z128_to_vex_test() { ret void }   
   define void @evex_scalar_to_vex_test() { ret void }   
   define void @evex_z256_to_evex_test() { ret void }
   define void @evex_z128_to_evex_test() { ret void }
   define void @evex_scalar_to_evex_test() { ret void }
...
---
  # CHECK-LABEL: name: evex_z256_to_vex_test
  # CHECK: bb.0:

name: evex_z256_to_vex_test                    
body: |                                        
  bb.0:                                        
  ; CHECK: VMOVAPDYmr                          %rdi, 1, %noreg, 0, %noreg, %ymm0
  VMOVAPDZ256mr                                %rdi, 1, %noreg, 0, %noreg, %ymm0                        
  ; CHECK: %ymm0 = VMOVAPDYrm                  %rip, 1, %noreg, %rax, %noreg
  %ymm0 = VMOVAPDZ256rm                        %rip, 1, %noreg, %rax, %noreg                            
  ; CHECK: %ymm0 = VMOVAPDYrr                  %ymm0
  %ymm0 = VMOVAPDZ256rr                        %ymm0                                          
  ; CHECK: %ymm0 = VMOVAPDYrr_REV              %ymm0
  %ymm0 = VMOVAPDZ256rr_REV                    %ymm0                                          
  ; CHECK: VMOVAPSYmr                          %rdi, 1, %noreg, 0, %noreg, %ymm0
  VMOVAPSZ256mr                                %rdi, 1, %noreg, 0, %noreg, %ymm0                        
  ; CHECK: %ymm0 = VMOVAPSYrm                  %rip, 1, %noreg, %rax, %noreg
  %ymm0 = VMOVAPSZ256rm                        %rip, 1, %noreg, %rax, %noreg                            
  ; CHECK: %ymm0 = VMOVAPSYrr                  %ymm0
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  ; CHECK: %ymm0 = VPADDUSBYrr                 %ymm0, %ymm1
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  ; CHECK: %ymm0 = VPADDWYrr                   %ymm0, %ymm1
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  ; CHECK: %ymm0 = VPSUBQYrm                   %ymm0, %rip, 1, %noreg, %rax, %noreg
  %ymm0 = VPSUBQZ256rm                         %ymm0, %rip, 1, %noreg, %rax, %noreg                     
  ; CHECK: %ymm0 = VPSUBQYrr                   %ymm0, %ymm1
  %ymm0 = VPSUBQZ256rr                         %ymm0, %ymm1                                   
  ; CHECK: %ymm0 = VPSUBSBYrm                  %ymm0, %rip, 1, %noreg, %rax, %noreg
  %ymm0 = VPSUBSBZ256rm                        %ymm0, %rip, 1, %noreg, %rax, %noreg                     
  ; CHECK: %ymm0 = VPSUBSBYrr                  %ymm0, %ymm1
  %ymm0 = VPSUBSBZ256rr                        %ymm0, %ymm1                                   
  ; CHECK: %ymm0 = VPSUBSWYrm                  %ymm0, %rip, 1, %noreg, %rax, %noreg
  %ymm0 = VPSUBSWZ256rm                        %ymm0, %rip, 1, %noreg, %rax, %noreg                     
  ; CHECK: %ymm0 = VPSUBSWYrr                  %ymm0, %ymm1
  %ymm0 = VPSUBSWZ256rr                        %ymm0, %ymm1                                   
  ; CHECK: %ymm0 = VPSUBUSBYrm                 %ymm0, %rip, 1, %noreg, %rax, %noreg
  %ymm0 = VPSUBUSBZ256rm                       %ymm0, %rip, 1, %noreg, %rax, %noreg                     
  ; CHECK: %ymm0 = VPSUBUSBYrr                 %ymm0, %ymm1
  %ymm0 = VPSUBUSBZ256rr                       %ymm0, %ymm1                                   
  ; CHECK: %ymm0 = VPSUBUSWYrm                 %ymm0, %rip, 1, %noreg, %rax, %noreg
  %ymm0 = VPSUBUSWZ256rm                       %ymm0, %rip, 1, %noreg, %rax, %noreg                     
  ; CHECK: %ymm0 = VPSUBUSWYrr                 %ymm0, %ymm1
  %ymm0 = VPSUBUSWZ256rr                       %ymm0, %ymm1                                   
  ; CHECK: %ymm0 = VPSUBWYrm                   %ymm0, %rip, 1, %noreg, %rax, %noreg
  %ymm0 = VPSUBWZ256rm                         %ymm0, %rip, 1, %noreg, %rax, %noreg                     
  ; CHECK: %ymm0 = VPSUBWYrr                   %ymm0, %ymm1
  %ymm0 = VPSUBWZ256rr                         %ymm0, %ymm1                                   
  ; CHECK: %ymm0 = VPXORYrm                    %ymm0, %rip, 1, %noreg, %rax, %noreg
  %ymm0 = VPXORDZ256rm                         %ymm0, %rip, 1, %noreg, %rax, %noreg                     
  ; CHECK: %ymm0 = VPXORYrr                    %ymm0, %ymm1
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  ; CHECK: %ymm0 = VPXORYrm                    %ymm0, %rip, 1, %noreg, %rax, %noreg
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  ; CHECK: %ymm0 = VPXORYrr                    %ymm0, %ymm1  
  %ymm0 = VPXORQZ256rr                         %ymm0, %ymm1                                   
  ; CHECK: %ymm0 = VADDPDYrm                   %ymm0, %rip, 1, %noreg, %rax, %noreg
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  ; CHECK: %ymm0 = VADDPDYrr                   %ymm0, %ymm1
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  ; CHECK: %ymm0 = VADDPSYrm                   %ymm0, %rip, 1, %noreg, %rax, %noreg 
  %ymm0 = VADDPSZ256rm                         %ymm0, %rip, 1, %noreg, %rax, %noreg                     
  ; CHECK: %ymm0 = VADDPSYrr                   %ymm0, %ymm1
  %ymm0 = VADDPSZ256rr                         %ymm0, %ymm1                                   
  ; CHECK: %ymm0 = VANDNPDYrm                  %ymm0, %rip, 1, %noreg, %rax, %noreg
  %ymm0 = VANDNPDZ256rm                        %ymm0, %rip, 1, %noreg, %rax, %noreg                     
  ; CHECK: %ymm0 = VANDNPDYrr                  %ymm0, %ymm1
  %ymm0 = VANDNPDZ256rr                        %ymm0, %ymm1                                   
  ; CHECK: %ymm0 = VANDNPSYrm                  %ymm0, %rip, 1, %noreg, %rax, %noreg 
  %ymm0 = VANDNPSZ256rm                        %ymm0, %rip, 1, %noreg, %rax, %noreg                     
  ; CHECK: %ymm0 = VANDNPSYrr                  %ymm0, %ymm1
  %ymm0 = VANDNPSZ256rr                        %ymm0, %ymm1                                   
  ; CHECK: %ymm0 = VANDPDYrm                   %ymm0, %rip, 1, %noreg, %rax, %noreg
  %ymm0 = VANDPDZ256rm                         %ymm0, %rip, 1, %noreg, %rax, %noreg                     
  ; CHECK: %ymm0 = VANDPDYrr                   %ymm0, %ymm1
  %ymm0 = VANDPDZ256rr                         %ymm0, %ymm1                                   
  ; CHECK: %ymm0 = VANDPSYrm                   %ymm0, %rip, 1, %noreg, %rax, %noreg
  %ymm0 = VANDPSZ256rm                         %ymm0, %rip, 1, %noreg, %rax, %noreg                     
  ; CHECK: %ymm0 = VANDPSYrr                   %ymm0, %ymm1
  %ymm0 = VANDPSZ256rr                         %ymm0, %ymm1                                   
  ; CHECK: %ymm0 = VDIVPDYrm                   %ymm0, %rip, 1, %noreg, %rax, %noreg
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  ; CHECK: %ymm0 = VDIVPDYrr                   %ymm0, %ymm1  
  %ymm0 = VDIVPDZ256rr                         %ymm0, %ymm1                                   
  ; CHECK: %ymm0 = VDIVPSYrm                   %ymm0, %rip, 1, %noreg, %rax, %noreg
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  ; CHECK: %ymm0 = VDIVPSYrr                   %ymm0, %ymm1
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  ; CHECK: %ymm0 = VMAXCPDYrm                  %ymm0, %rip, 1, %noreg, %rax, %noreg
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  ; CHECK: %ymm0 = VMAXCPDYrr                  %ymm0, %ymm1
  %ymm0 = VMAXCPDZ256rr                        %ymm0, %ymm1                                   
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  %ymm0 = VMAXCPSZ256rm                        %ymm0, %rip, 1, %noreg, %rax, %noreg                     
  ; CHECK: %ymm0 = VMAXCPSYrr                  %ymm0, %ymm1
  %ymm0 = VMAXCPSZ256rr                        %ymm0, %ymm1                                   
  ; CHECK: %ymm0 = VMAXCPDYrm                  %ymm0, %rip, 1, %noreg, %rax, %noreg
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  ; CHECK: %ymm0 = VMAXCPDYrr                  %ymm0, %ymm1
  %ymm0 = VMAXPDZ256rr                         %ymm0, %ymm1                                   
  ; CHECK: %ymm0 = VMAXCPSYrm                  %ymm0, %rip, 1, %noreg, %rax, %noreg
  %ymm0 = VMAXPSZ256rm                         %ymm0, %rip, 1, %noreg, %rax, %noreg                     
  ; CHECK: %ymm0 = VMAXCPSYrr                  %ymm0, %ymm1
  %ymm0 = VMAXPSZ256rr                         %ymm0, %ymm1                                   
  ; CHECK: %ymm0 = VMINCPDYrm                  %ymm0, %rip, 1, %noreg, %rax, %noreg
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  ; CHECK: %ymm0 = VMINCPDYrr                  %ymm0, %ymm1
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  ; CHECK: %ymm0 = VMINCPSYrm                  %ymm0, %rip, 1, %noreg, %rax, %noreg
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  ; CHECK: %ymm0 = VMINCPSYrr                  %ymm0, %ymm1
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  ; CHECK: %ymm0 = VMINCPDYrm                  %ymm0, %rip, 1, %noreg, %rax, %noreg
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  ; CHECK: %ymm0 = VMINCPDYrr                  %ymm0, %ymm1
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  ; CHECK: %ymm0 = VMINCPSYrr                  %ymm0, %ymm1
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  ; CHECK: %ymm0 = VUNPCKHPDYrr                %ymm0, %ymm1
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  ; CHECK: %ymm0 = VUNPCKHPSYrm                %ymm0, %rip, 1, %noreg, %rax, %noreg
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  ; CHECK: %ymm0 = VUNPCKHPSYrr                %ymm0, %ymm1
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  ; CHECK: %ymm0 = VUNPCKLPDYrm                %ymm0, %rip, 1, %noreg, %rax, %noreg
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  ; CHECK: %ymm0 = VPSLLVDYrm                  %ymm0, %rip, 1, %noreg, %rax, %noreg
  %ymm0 = VPSLLVDZ256rm                        %ymm0, %rip, 1, %noreg, %rax, %noreg                     
  ; CHECK: %ymm0 = VPSLLVDYrr                  %ymm0, 14
  %ymm0 = VPSLLVDZ256rr                        %ymm0, 14                                      
  ; CHECK: %ymm0 = VPSLLVQYrm                  %ymm0, %rip, 1, %noreg, %rax, %noreg
  %ymm0 = VPSLLVQZ256rm                        %ymm0, %rip, 1, %noreg, %rax, %noreg                     
  ; CHECK: %ymm0 = VPSLLVQYrr                  %ymm0, 14
  %ymm0 = VPSLLVQZ256rr                        %ymm0, 14                                      
  ; CHECK: %ymm0 = VPSLLWYri                   %ymm0, 7
  %ymm0 = VPSLLWZ256ri                         %ymm0, 7                                       
  ; CHECK: %ymm0 = VPSLLWYrm                   %ymm0, %rip, 1, %noreg, %rax, %noreg
  %ymm0 = VPSLLWZ256rm                         %ymm0, %rip, 1, %noreg, %rax, %noreg                     
  ; CHECK: %ymm0 = VPSLLWYrr                   %ymm0, 14                                  
  %ymm0 = VPSLLWZ256rr                         %ymm0, 14                                               
  ; CHECK: %ymm0 = VCVTDQ2PDYrm                %rdi, %ymm0, 1, %noreg, 0
  %ymm0 = VCVTDQ2PDZ256rm                      %rdi, %ymm0, 1, %noreg, 0                           
  ; CHECK: %ymm0 = VCVTDQ2PDYrr                %xmm0
  %ymm0 = VCVTDQ2PDZ256rr                      %xmm0                                          
  ; CHECK: %ymm0 = VCVTDQ2PSYrm                %rdi, %ymm0, 1, %noreg, 0
  %ymm0 = VCVTDQ2PSZ256rm                      %rdi, %ymm0, 1, %noreg, 0                           
  ; CHECK: %ymm0 = VCVTDQ2PSYrr                %ymm0
  %ymm0 = VCVTDQ2PSZ256rr                      %ymm0                                          
  ; CHECK: %xmm0 = VCVTPD2DQYrm                %rdi, %ymm0, 1, %noreg, 0
  %xmm0 = VCVTPD2DQZ256rm                      %rdi, %ymm0, 1, %noreg, 0                           
  ; CHECK: %xmm0 = VCVTPD2DQYrr                %ymm0
  %xmm0 = VCVTPD2DQZ256rr                      %ymm0                                          
  ; CHECK: %xmm0 = VCVTPD2PSYrm                %rdi, %ymm0, 1, %noreg, 0
  %xmm0 = VCVTPD2PSZ256rm                      %rdi, %ymm0, 1, %noreg, 0                           
  ; CHECK: %xmm0 = VCVTPD2PSYrr                %ymm0
  %xmm0 = VCVTPD2PSZ256rr                      %ymm0                                          
  ; CHECK: %ymm0 = VCVTPS2DQYrm                %rdi, %ymm0, 1, %noreg, 0
  %ymm0 = VCVTPS2DQZ256rm                      %rdi, %ymm0, 1, %noreg, 0                           
  ; CHECK: %ymm0 = VCVTPS2DQYrr                %ymm0  
  %ymm0 = VCVTPS2DQZ256rr                      %ymm0                                          
  ; CHECK: %ymm0 = VCVTPS2PDYrm                %rdi, %ymm0, 1, %noreg, 0  
  %ymm0 = VCVTPS2PDZ256rm                      %rdi, %ymm0, 1, %noreg, 0                           
  ; CHECK: %ymm0 = VCVTPS2PDYrr                %xmm0                                      
  %ymm0 = VCVTPS2PDZ256rr                      %xmm0                                               
  ; CHECK: VCVTPS2PHYmr                        %rdi, %ymm0, 1, %noreg, 0, %noreg, %noreg
  VCVTPS2PHZ256mr                              %rdi, %ymm0, 1, %noreg, 0, %noreg, %noreg                     
  ; CHECK: %xmm0 = VCVTPS2PHYrr                %ymm0, %noreg                                   
  %xmm0 = VCVTPS2PHZ256rr                      %ymm0, %noreg                                               
  ; CHECK: %ymm0 = VCVTPH2PSYrm                %rdi, %ymm0, 1, %noreg, 0
  %ymm0 = VCVTPH2PSZ256rm                      %rdi, %ymm0, 1, %noreg, 0                           
  ; CHECK: %ymm0 = VCVTPH2PSYrr                %xmm0      
  %ymm0 = VCVTPH2PSZ256rr                      %xmm0                                          
  ; CHECK: %xmm0 = VCVTTPD2DQYrm               %rdi, %ymm0, 1, %noreg, 0
  %xmm0 = VCVTTPD2DQZ256rm                     %rdi, %ymm0, 1, %noreg, 0                           
  ; CHECK: %xmm0 = VCVTTPD2DQYrr               %ymm0
  %xmm0 = VCVTTPD2DQZ256rr                     %ymm0                                          
  ; CHECK: %ymm0 = VCVTTPS2DQYrm               %rdi, %ymm0, 1, %noreg, 0
  %ymm0 = VCVTTPS2DQZ256rm                     %rdi, %ymm0, 1, %noreg, 0                           
  ; CHECK: %ymm0 = VCVTTPS2DQYrr               %ymm0                                      
  %ymm0 = VCVTTPS2DQZ256rr                     %ymm0                                               
  ; CHECK: %ymm0 = VSQRTPDYm                   %rdi, %noreg, %noreg, %noreg, %noreg 
  %ymm0 = VSQRTPDZ256m                         %rdi, %noreg, %noreg, %noreg, %noreg                               
  ; CHECK: %ymm0 = VSQRTPDYr                   %ymm0
  %ymm0 = VSQRTPDZ256r                         %ymm0                                          
  ; CHECK: %ymm0 = VSQRTPSYm                   %rdi, %noreg, %noreg, %noreg, %noreg
  %ymm0 = VSQRTPSZ256m                         %rdi, %noreg, %noreg, %noreg, %noreg                               
  ; CHECK: %ymm0 = VSQRTPSYr                   %ymm0                                      
  %ymm0 = VSQRTPSZ256r                         %ymm0                                                 
  ; CHECK: %ymm0 = VPALIGNRYrmi                %ymm0, %rdi, %noreg, %noreg, %noreg, %noreg, %noreg
  %ymm0 = VPALIGNRZ256rmi                      %ymm0, %rdi, %noreg, %noreg, %noreg, %noreg, %noreg                     
  ; CHECK: %ymm0 = VPALIGNRYrri                %ymm0, %ymm1, %noreg                            
  %ymm0 = VPALIGNRZ256rri                      %ymm0, %ymm1, %noreg                                               
  ; CHECK: %ymm0 = VMOVUPSYrm                  %rdi, 1, %noreg, 0, %noreg       
  %ymm0 = VMOVUPSZ256rm                        %rdi, 1, %noreg, 0, %noreg                               
  ; CHECK: %ymm0 = VMOVUPSYrr                  %ymm0
  %ymm0 = VMOVUPSZ256rr                        %ymm0                                          
  ; CHECK: %ymm0 = VMOVUPSYrr_REV              %ymm0                                      
  %ymm0 = VMOVUPSZ256rr_REV                    %ymm0                                                
  ; CHECK: %ymm0 = VPSHUFBYrm                  %ymm0, %noreg, %noreg, %noreg, %noreg, %noreg
  %ymm0 = VPSHUFBZ256rm                        %ymm0, %noreg, %noreg, %noreg, %noreg, %noreg                           
  ; CHECK: %ymm0 = VPSHUFBYrr                  %ymm0, %ymm1
  %ymm0 = VPSHUFBZ256rr                        %ymm0, %ymm1                                   
  ; CHECK: %ymm0 = VPSHUFDYmi                  %rdi, 1, %noreg, 0, %noreg, %noreg
  %ymm0 = VPSHUFDZ256mi                        %rdi, 1, %noreg, 0, %noreg, %noreg                            
  ; CHECK: %ymm0 = VPSHUFDYri                  %ymm0, -24
  %ymm0 = VPSHUFDZ256ri                        %ymm0, -24                                     
  ; CHECK: %ymm0 = VPSHUFHWYmi                 %rdi, 1, %noreg, 0, %noreg, %noreg
  %ymm0 = VPSHUFHWZ256mi                       %rdi, 1, %noreg, 0, %noreg, %noreg                            
  ; CHECK: %ymm0 = VPSHUFHWYri                 %ymm0, -24
  %ymm0 = VPSHUFHWZ256ri                       %ymm0, -24                                     
  ; CHECK: %ymm0 = VPSHUFLWYmi                 %rdi, 1, %noreg, 0, %noreg, %noreg
  %ymm0 = VPSHUFLWZ256mi                       %rdi, 1, %noreg, 0, %noreg, %noreg                            
  ; CHECK: %ymm0 = VPSHUFLWYri                 %ymm0, -24
  %ymm0 = VPSHUFLWZ256ri                       %ymm0, -24                                     
  ; CHECK: %ymm0 = VSHUFPDYrmi                 %ymm0, %noreg, %noreg, %noreg, %noreg, %noreg, %noreg
  %ymm0 = VSHUFPDZ256rmi                       %ymm0, %noreg, %noreg, %noreg, %noreg, %noreg, %noreg                        
  ; CHECK: %ymm0 = VSHUFPDYrri                 %ymm0, %noreg, %noreg
  %ymm0 = VSHUFPDZ256rri                       %ymm0, %noreg, %noreg                                    
  ; CHECK: %ymm0 = VSHUFPSYrmi                 %ymm0, %noreg, %noreg, %noreg, %noreg, %noreg, %noreg
  %ymm0 = VSHUFPSZ256rmi                       %ymm0, %noreg, %noreg, %noreg, %noreg, %noreg, %noreg                        
  ; CHECK: %ymm0 = VSHUFPSYrri                 %ymm0, %noreg, %noreg
  %ymm0 = VSHUFPSZ256rri                       %ymm0, %noreg, %noreg

    RET 0, %zmm0, %zmm1
...
---
  # CHECK-LABEL: name: evex_z128_to_vex_test
  # CHECK: bb.0:

name: evex_z128_to_vex_test
body: |
  bb.0:
  ; CHECK: VMOVAPDmr                           %rdi, 1, %noreg, 0, %noreg, %xmm0
  VMOVAPDZ128mr                                %rdi, 1, %noreg, 0, %noreg, %xmm0                             
  ; CHECK: %xmm0 = VMOVAPDrm                   %rip, 1, %noreg, %rax, %noreg
  %xmm0 = VMOVAPDZ128rm                        %rip, 1, %noreg, %rax, %noreg                                 
  ; CHECK: %xmm0 = VMOVAPDrr                   %xmm0
  %xmm0 = VMOVAPDZ128rr                        %xmm0                                               
  ; CHECK: VMOVAPSmr                           %rdi, 1, %noreg, 0, %noreg, %xmm0
  VMOVAPSZ128mr                                %rdi, 1, %noreg, 0, %noreg, %xmm0                             
  ; CHECK: %xmm0 = VMOVAPSrm                   %rip, 1, %noreg, %rax, %noreg
  %xmm0 = VMOVAPSZ128rm                        %rip, 1, %noreg, %rax, %noreg                                 
  ; CHECK: %xmm0 = VMOVAPSrr                   %xmm0  
  %xmm0 = VMOVAPSZ128rr                        %xmm0                                               
  ; CHECK: VMOVDQAmr                           %rdi, 1, %noreg, 0, %noreg, %xmm0
  VMOVDQA32Z128mr                              %rdi, 1, %noreg, 0, %noreg, %xmm0                             
  ; CHECK: %xmm0 = VMOVDQArm                   %rip, 1, %noreg, %rax, %noreg
  %xmm0 = VMOVDQA32Z128rm                      %rip, 1, %noreg, %rax, %noreg                                 
  ; CHECK: %xmm0 = VMOVDQArr                   %xmm0
  %xmm0 = VMOVDQA32Z128rr                      %xmm0                                               
  ; CHECK: VMOVDQAmr                           %rdi, 1, %noreg, 0, %noreg, %xmm0
  VMOVDQA64Z128mr                              %rdi, 1, %noreg, 0, %noreg, %xmm0                             
  ; CHECK: %xmm0 = VMOVDQArm                   %rip, 1, %noreg, %rax, %noreg
  %xmm0 = VMOVDQA64Z128rm                      %rip, 1, %noreg, %rax, %noreg                                 
  ; CHECK: %xmm0 = VMOVDQArr                   %xmm0
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  ; CHECK: %xmm0 = VFNMSUB231PSr               %xmm0, %xmm1, %xmm2                     
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  ; CHECK: %xmm0 = VPSLLQri                    %xmm0, 7
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  ; CHECK: %xmm0 = VPSLLQrr                    %xmm0, 14
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  ; CHECK: %xmm0 = VPSLLVDrr                   %xmm0, 14
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  ; CHECK: %xmm0 = VPSLLVQrr                   %xmm0, 14 
  %xmm0 = VPSLLVQZ128rr                        %xmm0, 14                                           
  ; CHECK: %xmm0 = VPSLLWri                    %xmm0, 7
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  ; CHECK: %xmm0 = VPSLLWrm                    %xmm0, %rip, 1, %noreg, %rax, %noreg 
  %xmm0 = VPSLLWZ128rm                         %xmm0, %rip, 1, %noreg, %rax, %noreg                          
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  ; CHECK: %xmm0 = VPSRADri                    %xmm0, 7
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  ; CHECK: %xmm0 = VPSRADrm                    %xmm0, %rip, 1, %noreg, %rax, %noreg  
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  ; CHECK: %xmm0 = VPSRADrr                    %xmm0, 14 
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  ; CHECK: %xmm0 = VPSRAVDrr                   %xmm0, 14  
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  ; CHECK: %xmm0 = VPSRAWri                    %xmm0, 7 
  %xmm0 = VPSRAWZ128ri                         %xmm0, 7                                            
  ; CHECK: %xmm0 = VPSRAWrm                    %xmm0, %rip, 1, %noreg, %rax, %noreg  
  %xmm0 = VPSRAWZ128rm                         %xmm0, %rip, 1, %noreg, %rax, %noreg                          
  ; CHECK: %xmm0 = VPSRAWrr                    %xmm0, 14  
  %xmm0 = VPSRAWZ128rr                         %xmm0, 14                                           
  ; CHECK: %xmm0 = VPSRLDQri                   %xmm0, 14
  %xmm0 = VPSRLDQZ128rr                        %xmm0, 14                                           
  ; CHECK: %xmm0 = VPSRLDri                    %xmm0, 7 
  %xmm0 = VPSRLDZ128ri                         %xmm0, 7                                            
  ; CHECK: %xmm0 = VPSRLDrm                    %xmm0, %rip, 1, %noreg, %rax, %noreg 
  %xmm0 = VPSRLDZ128rm                         %xmm0, %rip, 1, %noreg, %rax, %noreg                          
  ; CHECK: %xmm0 = VPSRLDrr                    %xmm0, 14 
  %xmm0 = VPSRLDZ128rr                         %xmm0, 14                                           
  ; CHECK: %xmm0 = VPSRLQri                    %xmm0, 7 
  %xmm0 = VPSRLQZ128ri                         %xmm0, 7                                            
  ; CHECK: %xmm0 = VPSRLQrm                    %xmm0, %rip, 1, %noreg, %rax, %noreg
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  ; CHECK: %xmm0 = VPSRLQrr                    %xmm0, 14
  %xmm0 = VPSRLQZ128rr                         %xmm0, 14                                           
  ; CHECK: %xmm0 = VPSRLVDrm                   %xmm0, %rip, 1, %noreg, %rax, %noreg
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  ; CHECK: %xmm0 = VPSRLVDrr                   %xmm0, 14
  %xmm0 = VPSRLVDZ128rr                        %xmm0, 14                                           
  ; CHECK: %xmm0 = VPSRLVQrm                   %xmm0, %rip, 1, %noreg, %rax, %noreg
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  ; CHECK: %xmm0 = VPSRLVQrr                   %xmm0, 14
  %xmm0 = VPSRLVQZ128rr                        %xmm0, 14                                           
  ; CHECK: %xmm0 = VPSRLWri                    %xmm0, 7
  %xmm0 = VPSRLWZ128ri                         %xmm0, 7                                            
  ; CHECK: %xmm0 = VPSRLWrm                    %xmm0, %rip, 1, %noreg, %rax, %noreg
  %xmm0 = VPSRLWZ128rm                         %xmm0, %rip, 1, %noreg, %rax, %noreg                          
  ; CHECK: %xmm0 = VPSRLWrr                    %xmm0, 14                               
  %xmm0 = VPSRLWZ128rr                         %xmm0, 14                                               
  ; CHECK: %xmm0 = VPERMILPDmi                 %rdi, 1, %noreg, 0, %noreg, %noreg
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  ; CHECK: %xmm0 = VPERMILPDri                 %xmm0, 9
  %xmm0 = VPERMILPDZ128ri                      %xmm0, 9                                            
  ; CHECK: %xmm0 = VPERMILPDrm                 %xmm0, %rdi, 1, %noreg, 0, %noreg
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  ; CHECK: %xmm0 = VPERMILPDrr                 %xmm0, %xmm1
  %xmm0 = VPERMILPDZ128rr                      %xmm0, %xmm1                                        
  ; CHECK: %xmm0 = VPERMILPSmi                 %rdi, 1, %noreg, 0, %noreg, %noreg
  %xmm0 = VPERMILPSZ128mi                      %rdi, 1, %noreg, 0, %noreg, %noreg                                 
  ; CHECK: %xmm0 = VPERMILPSri                 %xmm0, 9
  %xmm0 = VPERMILPSZ128ri                      %xmm0, 9                                            
  ; CHECK: %xmm0 = VPERMILPSrm                 %xmm0, %rdi, 1, %noreg, 0, %noreg
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  ; CHECK: %xmm0 = VPERMILPSrr                 %xmm0, %xmm1                            
  %xmm0 = VPERMILPSZ128rr                      %xmm0, %xmm1                                               
  ; CHECK: %xmm0 = VCVTPH2PSrm                 %rdi, %xmm0, 1, %noreg, 0    
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  ; CHECK: %xmm0 = VCVTPH2PSrr                 %xmm0
  %xmm0 = VCVTPH2PSZ128rr                      %xmm0                                               
  ; CHECK: %xmm0 = VCVTDQ2PDrm                 %rdi, %xmm0, 1, %noreg, 0  
  %xmm0 = VCVTDQ2PDZ128rm                      %rdi, %xmm0, 1, %noreg, 0                                
  ; CHECK: %xmm0 = VCVTDQ2PDrr                 %xmm0     
  %xmm0 = VCVTDQ2PDZ128rr                      %xmm0                                               
  ; CHECK: %xmm0 = VCVTDQ2PSrm                 %rdi, %xmm0, 1, %noreg, 0
  %xmm0 = VCVTDQ2PSZ128rm                      %rdi, %xmm0, 1, %noreg, 0                                
  ; CHECK: %xmm0 = VCVTDQ2PSrr                 %xmm0   
  %xmm0 = VCVTDQ2PSZ128rr                      %xmm0                                               
  ; CHECK: %xmm0 = VCVTPD2DQrm                 %rdi, %xmm0, 1, %noreg, 0  
  %xmm0 = VCVTPD2DQZ128rm                      %rdi, %xmm0, 1, %noreg, 0                                
  ; CHECK: %xmm0 = VCVTPD2DQrr                 %xmm0   
  %xmm0 = VCVTPD2DQZ128rr                      %xmm0                                               
  ; CHECK: %xmm0 = VCVTPD2PSrm                 %rdi, %xmm0, 1, %noreg, 0  
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  ; CHECK: %xmm0 = VCVTPD2PSrr                 %xmm0   
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  ; CHECK: %xmm0 = VCVTPS2DQrm                 %rdi, %xmm0, 1, %noreg, 0  
  %xmm0 = VCVTPS2DQZ128rm                      %rdi, %xmm0, 1, %noreg, 0                                
  ; CHECK: %xmm0 = VCVTPS2DQrr                 %xmm0   
  %xmm0 = VCVTPS2DQZ128rr                      %xmm0                                               
  ; CHECK: %xmm0 = VCVTPS2PDrm                 %rdi, %xmm0, 1, %noreg, 0         
  %xmm0 = VCVTPS2PDZ128rm                      %rdi, %xmm0, 1, %noreg, 0                                
  ; CHECK: %xmm0 = VCVTPS2PDrr                 %xmm0
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  %xmm0 = VCVTTPD2DQZ128rm                     %rdi, %xmm0, 1, %noreg, 0                                
  ; CHECK: %xmm0 = VCVTTPD2DQrr                %xmm0  
  %xmm0 = VCVTTPD2DQZ128rr                     %xmm0                                               
  ; CHECK: %xmm0 = VCVTTPS2DQrm                %rdi, %xmm0, 1, %noreg, 0  
  %xmm0 = VCVTTPS2DQZ128rm                     %rdi, %xmm0, 1, %noreg, 0                                
  ; CHECK: %xmm0 = VCVTTPS2DQrr                %xmm0                                   
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  %xmm0 = VSQRTPDZ128r                         %xmm0                                               
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  ; CHECK: %xmm0 = VMOVDDUPrr                  %xmm0    
  %xmm0 = VMOVDDUPZ128rr                       %xmm0                                               
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  ; CHECK: %xmm0 = VMOVSHDUPrr                 %xmm0    
  %xmm0 = VMOVSHDUPZ128rr                      %xmm0                                               
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  %xmm0 = VMOVSLDUPZ128rm                      %rdi, 1, %noreg, 0, %noreg                                    
  ; CHECK: %xmm0 = VMOVSLDUPrr                 %xmm0                                   
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  ; CHECK: %xmm0 = VPSHUFBrr                   %xmm0, %xmm1
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  ; CHECK: %xmm0 = VPSHUFHWri                  %xmm0, -24
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  ; CHECK: %xmm0 = VPSHUFLWri                  %xmm0, -24
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  ; CHECK: %xmm0 = VSHUFPDrmi                  %xmm0, %noreg, %noreg, %noreg, %noreg, %noreg, %noreg
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  %xmm0 = VSHUFPSZ128rri                       %xmm0, %noreg, %noreg                                               
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  ; CHECK: %xmm0 = VPSADBWrr                   %xmm0, %xmm1                            
  %xmm0 = VPSADBWZ128rr                        %xmm0, %xmm1                                               
  ; CHECK: %xmm0 = VBROADCASTSSrm              %rip, %noreg, %noreg, %noreg, %noreg
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  ; CHECK: %xmm0 = VBROADCASTSSrr              %xmm0
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  ; CHECK: %xmm0 = VPBROADCASTBrr              %xmm0
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  ; CHECK: %xmm0 = VPBROADCASTDrm              %rip, %noreg, %noreg, %noreg, %noreg
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  ; CHECK: %xmm0 = VPBROADCASTDrr              %xmm0
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  ; CHECK: %xmm0 = VPBROADCASTQrm              %rip, %noreg, %noreg, %noreg, %noreg
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  ; CHECK: %xmm0 = VPBROADCASTQrr              %xmm0
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  ; CHECK: %xmm0 = VPBROADCASTWrm              %rip, %noreg, %noreg, %noreg, %noreg 
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  ; CHECK: %xmm0 = VPBROADCASTWrr              %xmm0                                   
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  ; CHECK: %xmm0 = VPBROADCASTQrm              %rip, %noreg, %noreg, %noreg, %noreg
  %xmm0 = VBROADCASTI32X2Z128m                 %rip, %noreg, %noreg, %noreg, %noreg
  ; CHECK: %xmm0 = VPBROADCASTQrr              %xmm0
  %xmm0 = VBROADCASTI32X2Z128r                 %xmm0
  ; CHECK: %xmm0 = VCVTPS2PHrr                 %xmm0, 2
  %xmm0 = VCVTPS2PHZ128rr                      %xmm0, 2                                            
  ; CHECK: VCVTPS2PHmr                         %rdi, %xmm0, 1, %noreg, 0, %noreg, %noreg              
  VCVTPS2PHZ128mr                              %rdi, %xmm0, 1, %noreg, 0, %noreg, %noreg                                               
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  %xmm0 = VPABSBZ128rm                         %rip, 1, %noreg, %rax, %noreg                                 
  ; CHECK: %xmm0 = VPABSBrr                    %xmm0
  %xmm0 = VPABSBZ128rr                         %xmm0                                               
  ; CHECK: %xmm0 = VPABSDrm                    %rip, 1, %noreg, %rax, %noreg
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  ; CHECK: %xmm0 = VPABSDrr                    %xmm0
  %xmm0 = VPABSDZ128rr                         %xmm0                                               
  ; CHECK: %xmm0 = VPABSWrm                    %rip, 1, %noreg, %rax, %noreg
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  ; CHECK: %xmm0 = VPABSWrr                    %xmm0
  %xmm0 = VPABSWZ128rr                         %xmm0                                               
  ; CHECK: %xmm0 = VPALIGNRrmi                 %xmm0, %noreg, %noreg, %noreg, %noreg, %noreg, %noreg
  %xmm0 = VPALIGNRZ128rmi                      %xmm0, %noreg, %noreg, %noreg, %noreg, %noreg, %noreg                             
  ; CHECK: %xmm0 = VPALIGNRrri                 %xmm0, %xmm1, 15
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      RET 0, %zmm0, %zmm1
...
---
  # CHECK-LABEL: name: evex_scalar_to_vex_test
  # CHECK: bb.0:

name: evex_scalar_to_vex_test
body: |
  bb.0:

  ; CHECK: %xmm0 = VADDSDrm                    %xmm0, %rip, 1, %noreg, %rax, %noreg
  %xmm0 = VADDSDZrm                            %xmm0, %rip, 1, %noreg, %rax, %noreg                              
  ; CHECK: %xmm0 = VADDSDrm_Int                %xmm0, %rip, 1, %noreg, %rax, %noreg
  %xmm0 = VADDSDZrm_Int                        %xmm0, %rip, 1, %noreg, %rax, %noreg                              
  ; CHECK: %xmm0 = VADDSDrr                    %xmm0, %xmm1  
  %xmm0 = VADDSDZrr                            %xmm0, %xmm1                                            
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  ; CHECK: %xmm0 = VADDSSrr                    %xmm0, %xmm1
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  ; CHECK: %xmm0 = VADDSSrr_Int                %xmm0, %xmm1
  %xmm0 = VADDSSZrr_Int                        %xmm0, %xmm1                                            
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  ; CHECK: %xmm0 = VFMADD132SDr_Int            %xmm0, %xmm1, %xmm2
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  ; CHECK: %xmm0 = VFMADD132SSm_Int            %xmm0, %xmm0, %rsi, 1, %noreg, 0, %noreg
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  ; CHECK: %xmm0 = VFNMADD231SDr               %xmm0, %xmm1, %xmm2
  %xmm0 = VFNMADD231SDZr                       %xmm0, %xmm1, %xmm2                                     
  ; CHECK: %xmm0 = VFNMADD231SDr_Int           %xmm0, %xmm1, %xmm2
  %xmm0 = VFNMADD231SDZr_Int                   %xmm0, %xmm1, %xmm2                                     
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  ; CHECK: %xmm0 = VFNMADD231SSm_Int           %xmm0, %xmm0, %rsi, 1, %noreg, 0, %noreg
  %xmm0 = VFNMADD231SSZm_Int                   %xmm0, %xmm0, %rsi, 1, %noreg, 0, %noreg                          
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  ; CHECK: %xmm0 = VFNMADD231SSr_Int           %xmm0, %xmm1, %xmm2
  %xmm0 = VFNMADD231SSZr_Int                   %xmm0, %xmm1, %xmm2                                     
  ; CHECK: %xmm0 = VFNMSUB132SDm               %xmm0, %xmm0, %rsi, 1, %noreg, 0, %noreg
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  ; CHECK: %xmm0 = VFNMSUB132SDm_Int           %xmm0, %xmm0, %rsi, 1, %noreg, 0, %noreg
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  ; CHECK: %xmm0 = VFNMSUB132SSr_Int           %xmm0, %xmm1, %xmm2
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  ; CHECK: %xmm0 = VFNMSUB213SDr_Int           %xmm0, %xmm1, %xmm2
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  ; CHECK: %xmm0 = VFNMSUB213SSr               %xmm0, %xmm1, %xmm2
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  ; CHECK: %xmm0 = VFNMSUB213SSr_Int           %xmm0, %xmm1, %xmm2
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  ; CHECK: %xmm0 = VFNMSUB231SDr               %xmm0, %xmm1, %xmm2
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  ; CHECK: %xmm0 = VFNMSUB231SDr_Int           %xmm0, %xmm1, %xmm2
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  ; CHECK: %xmm0 = VFNMSUB231SSm               %xmm0, %xmm0, %rsi, 1, %noreg, 0, %noreg
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  ; CHECK: %xmm0 = VFNMSUB231SSm_Int           %xmm0, %xmm0, %rsi, 1, %noreg, 0, %noreg
  %xmm0 = VFNMSUB231SSZm_Int                   %xmm0, %xmm0, %rsi, 1, %noreg, 0, %noreg                          
  ; CHECK: %xmm0 = VFNMSUB231SSr               %xmm0, %xmm1, %xmm2
  %xmm0 = VFNMSUB231SSZr                       %xmm0, %xmm1, %xmm2                                     
  ; CHECK: %xmm0 = VFNMSUB231SSr_Int           %xmm0, %xmm1, %xmm2                                               
  %xmm0 = VFNMSUB231SSZr_Int                   %xmm0, %xmm1, %xmm2                                               
  ; CHECK: VPEXTRBmr                           %rdi, 1, %noreg, 0, %noreg, %xmm0, 3       
  VPEXTRBZmr                                   %rdi, 1, %noreg, 0, %noreg, %xmm0, 3                              
  ; CHECK: %eax = VPEXTRBrr                    %xmm0, 1    
  %eax = VPEXTRBZrr                            %xmm0, 1                                                
  ; CHECK: VPEXTRDmr                           %rdi, 1, %noreg, 0, %noreg, %xmm0, 3      
  VPEXTRDZmr                                   %rdi, 1, %noreg, 0, %noreg, %xmm0, 3                              
  ; CHECK: %eax = VPEXTRDrr                    %xmm0, 1     
  %eax = VPEXTRDZrr                            %xmm0, 1                                                
  ; CHECK: VPEXTRQmr                           %rdi, 1, %noreg, 0, %noreg, %xmm0, 3       
  VPEXTRQZmr                                   %rdi, 1, %noreg, 0, %noreg, %xmm0, 3                              
  ; CHECK: %rax = VPEXTRQrr                    %xmm0, 1      
  %rax = VPEXTRQZrr                            %xmm0, 1                                                
  ; CHECK: VPEXTRWmr                           %rdi, 1, %noreg, 0, %noreg,  %xmm0, 3       
  VPEXTRWZmr                                   %rdi, 1, %noreg, 0, %noreg,  %xmm0, 3                             
  ; CHECK: %eax = VPEXTRWri                    %xmm0, 1                                                     
  %eax = VPEXTRWZrr                            %xmm0, 1                                                    
  ; CHECK: %eax = VPEXTRWrr_REV               %xmm0, 1      
  %eax = VPEXTRWZrr_REV                        %xmm0, 1                                                     
  ; CHECK: %xmm0 = VPINSRBrm                   %xmm0, %rsi, 1, %noreg, 0, %noreg, 3      
  %xmm0 = VPINSRBZrm                           %xmm0, %rsi, 1, %noreg, 0, %noreg, 3                              
  ; CHECK: %xmm0 = VPINSRBrr                   %xmm0, %edi, 5      
  %xmm0 = VPINSRBZrr                           %xmm0, %edi, 5                                          
  ; CHECK: %xmm0 = VPINSRDrm                   %xmm0, %rsi, 1, %noreg, 0, %noreg, 3      
  %xmm0 = VPINSRDZrm                           %xmm0, %rsi, 1, %noreg, 0, %noreg, 3                              
  ; CHECK: %xmm0 = VPINSRDrr                   %xmm0, %edi, 5            
  %xmm0 = VPINSRDZrr                           %xmm0, %edi, 5                                          
  ; CHECK: %xmm0 = VPINSRQrm                   %xmm0, %rsi, 1, %noreg, 0, %noreg, 3      
  %xmm0 = VPINSRQZrm                           %xmm0, %rsi, 1, %noreg, 0, %noreg, 3                              
  ; CHECK: %xmm0 = VPINSRQrr                   %xmm0, %rdi, 5            
  %xmm0 = VPINSRQZrr                           %xmm0, %rdi, 5                                          
  ; CHECK: %xmm0 = VPINSRWrmi                  %xmm0, %rsi, 1, %noreg, 0, %noreg, 3      
  %xmm0 = VPINSRWZrm                           %xmm0, %rsi, 1, %noreg, 0, %noreg, 3                              
  ; CHECK: %xmm0 = VPINSRWrri                  %xmm0, %edi, 5                                               
  %xmm0 = VPINSRWZrr                           %xmm0, %edi, 5                                              
  ; CHECK: %xmm0 = VSQRTSDm                    %xmm0, %noreg, %noreg, %noreg, %noreg, %noreg
  %xmm0 = VSQRTSDZm                            %xmm0, %noreg, %noreg, %noreg, %noreg, %noreg                                    
  ; CHECK: %xmm0 = VSQRTSDm_Int                %xmm0, %noreg, %noreg, %noreg, %noreg, %noreg
  %xmm0 = VSQRTSDZm_Int                        %xmm0, %noreg, %noreg, %noreg, %noreg, %noreg                                    
  ; CHECK: %xmm0 = VSQRTSDr                    %xmm0, %noreg 
  %xmm0 = VSQRTSDZr                            %xmm0, %noreg                                                
  ; CHECK: %xmm0 = VSQRTSDr_Int                %xmm0, %noreg
  %xmm0 = VSQRTSDZr_Int                        %xmm0, %noreg                                                
  ; CHECK: %xmm0 = VSQRTSSm                    %xmm0, %noreg, %noreg, %noreg, %noreg, %noreg
  %xmm0 = VSQRTSSZm                            %xmm0, %noreg, %noreg, %noreg, %noreg, %noreg                                    
  ; CHECK: %xmm0 = VSQRTSSm_Int                %xmm0, %noreg, %noreg, %noreg, %noreg, %noreg
  %xmm0 = VSQRTSSZm_Int                        %xmm0, %noreg, %noreg, %noreg, %noreg, %noreg                                    
  ; CHECK: %xmm0 = VSQRTSSr                    %xmm0, %noreg
  %xmm0 = VSQRTSSZr                            %xmm0, %noreg                                                
  ; CHECK: %xmm0 = VSQRTSSr_Int                %xmm0, %noreg                                              
  %xmm0 = VSQRTSSZr_Int                        %xmm0, %noreg                                                
  ; CHECK: %rdi = VCVTSD2SI64rr                %xmm0
  %rdi = VCVTSD2SI64Zrr                        %xmm0                                                   
  ; CHECK: %edi = VCVTSD2SIrr                  %xmm0
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  ; CHECK: %rdi = VCVTTSS2SI64rr               %xmm0
  %rdi = VCVTTSS2SI64Zrr                       %xmm0                                                   
  ; CHECK: %rdi = Int_VCVTTSS2SI64rr           %xmm0
  %rdi = VCVTTSS2SI64Zrr_Int                   %xmm0                                                   
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  ; CHECK: %edi = VCVTTSS2SIrr                 %xmm0
  %edi = VCVTTSS2SIZrr                         %xmm0                                                   
  ; CHECK: %edi = Int_VCVTTSS2SIrr             %xmm0                                               
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  %xmm0 = VMOV64toSDZrr                        %rdi                                                    
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  ; CHECK: %xmm0 = VMOV64toPQIrm               %rdi, %noreg, %noreg, %noreg, %noreg
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...
---
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  # CHECK: bb.0:

name: evex_z256_to_evex_test
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  bb.0:
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  bb.0:
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